Intel Core 2 Duo E8800 (ES)
Intel Core 2 Duo E6200 (ES)
Intel Core 2 Duo E7700
Intel Pentium II 266 (0,35µ)
Intel Core 2 Duo E7800
AMD EPYC 7J13
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Marque | AMD | ||
Modèle | EPYC | ||
Architecture | x86 | ||
Nom de code | Milan | ||
Fréquence (Nominale/Boost) | 2.55 GHz/3.5 GHz | ||
Coeurs/Threads | 64/128 | ||
Type de marché ciblé | Serveurs | ||
Format / Support | LGA-4094 / Socket SP3 | ||
Caractéristiques mécaniques | |||
Dimensions | 7,54x5,85 cm | Finesse de gravure | 7 nm |
Taille du Die (CPU+IGP) | 8x80.7+416 mm² | Nombre de transistors | ??? |
Caractéristiques électriques | |||
Tension | ??? | TDP | 280 W |
Bus | |||
Type de Bus | Infinity Fabric+PCI-Express 4.0 | Largeur | 64 bits |
Caches | |||
Cache L1 (data) | 64x32 Ko | Cache L1 (instruction) | 64x32 Ko |
Cache L2 | 64x512 Ko | Cache L3 | 256 Mo |
Autres informations | |||
Fonctions/Spécificités |
16-bit Floating-Point conversion instructions (F16C) 3-operand Fused Multiply-Add instructions (FMA3) Advanced Vector Extensions (AVX) Advanced Vector Extensions 2 (AVX2) AES New Instructions BMI Enhanced Virus Protection (EVP) MMX Pacifica Precision Boost 2 Pure Power Secure Hash Algorithm extensions (SHA) Secure Mode Execution Protection (SMEP) Simultaneous MultiThreading (SMT) SSE SSE2 SSE3 SSE4.1 SSE4.2 SSE4a SSSE3 Supervisor Mode Access Prevention (SMAP) x86-64 instructions |
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Périphériques intégrés |
Contrôleur mémoire DDR4-3200 Octo Channel Contrôleur PCI-Express 4.0 128 lignes Contrôleur Serial-ATA 3.0 Contrôleur USB 3.0 Contrôleur I2C Interface SPI Interface LPC Contrôleur hôte SMBus UART High Speed Ports E/S génériques Horloge temps réel |
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Rareté | |||
Dans collection ? | non | ||
Benchmarks |